差别

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--- analog_circuit_learning_kit [2023/10/16 15:20]
gongyu
+++ analog_circuit_learning_kit [2023/10/18 15:49]
gongyu [5. 实验]
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 {{ :pwm_awg_freq.png |}}<WRAP centeralign>用LTSpice仿真的频域效果</WRAP>
+**实际测试:**
+MHz输入时钟，经过PLL后得到396MHz的内部时钟，用于PWM信号的生成。
+AWG信号的幅度采用10位精度，因此DDS的转换时钟为396MHz/1024 ~ 386.71875Ksps
+要得到20KHz的模拟信号，24位的相位累加字为24'H0D3D56
+{{ ::pwm_awg_20khz_wave.png |}}<WRAP centeralign>396MHz主频生成20KHz的模拟信号波形</WRAP>
+{{ ::pwm_awg_20khz_spec.png |}}<WRAP centeralign>396MHz主频生成20KHz的模拟信号频谱</WRAP>
+在频谱上可以看到在386.71875KHz左右各有一个20KHz的镜像频率366.71875KHz和406.71875KHz的频率分量，这是因为我们低通滤波器在366KHz ~ 406MHz的抑制度比较低，如果采用更高阶的低通滤波器，可以将这部分的频率分量压制下来。
+{{ ::pwm_awg_20khz_sim.png |}}<WRAP centeralign>使用simDDS查看生成信号的频谱 - 没有加低通滤波器</WRAP>
+{{ ::pwm_awg_20khz_lpf.png |}}<WRAP centeralign>使用simDDS查看添加了2阶低通滤波器后的频谱</WRAP>
+{{ ::pwm_awg_20khz_lpf1.png |}}<WRAP centeralign>使用simDDS查看添加了2阶低通滤波器后的杂散信号表</WRAP>
+{{ ::pwm_awg_20khz_lpf2.png |}}<WRAP centeralign>使用simDDS查看添加了5阶低通滤波器后的频谱</WRAP>
 #### 3.5 可调直流电压生成
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   - 线性稳压/LDO稳压器
   - 电荷泵/负电压生成
+### 6. 开机测试
+使用Lattice XO2-4000HC FPGA小脚丫，下载测试程序：{{:acdlk_test_impl1.rar|模拟信号训练学习平台FPGA代码}}，解压后生成jed文件可以下载。
+连接方式见图片：{{ :acdlk_test_setup.jpg |测试连接方式}}