差别

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后一修订版
前一修订版
上一修订版 两侧同时换到之后的修订记录
altera_10tra [2017/05/31 14:10]
group002
altera_10tra [2019/12/24 10:30]
anran [====Verilog代码====]
行 8: 行 8:
 {{ ::​jiaotongdeng.png?​300 |}} {{ ::​jiaotongdeng.png?​300 |}}
 上图为十字路口交通示意图分之路与主路,要求如下: 上图为十字路口交通示意图分之路与主路,要求如下:
-* 交通灯主路上绿灯持续15s的时间,黄灯3s的时间,红灯10s的时间; +  ​* 交通灯主路上绿灯持续15s的时间,黄灯3s的时间,红灯10s的时间; 
-* 交通灯支路上绿灯持续7s的时间, 黄灯持续3秒的时间,红灯18秒的时间;+  * 交通灯支路上绿灯持续7s的时间, 黄灯持续3秒的时间,红灯18秒的时间;
 {{ ::​状态机框架.png?​300 |}} {{ ::​状态机框架.png?​300 |}}
 根据上述要求,状态机设计框架分析如下: 根据上述要求,状态机设计框架分析如下:
-* S1:​主路绿灯点亮,支路红灯点亮,持续15s的时间; +  ​* S1:​主路绿灯点亮,支路红灯点亮,持续15s的时间; 
-* S2:​主路黄灯点亮,支路红灯点亮,持续3s的时间; +  * S2:​主路黄灯点亮,支路红灯点亮,持续3s的时间; 
-* S3:​主路红灯点亮,支路绿灯点亮,持续10s的时间; +  * S3:​主路红灯点亮,支路绿灯点亮,持续10s的时间; 
-* S4:​主路红灯点亮,支路黄灯点亮,持续3s的时间; +  * S4:​主路红灯点亮,支路黄灯点亮,持续3s的时间; 
-{{ ::​状态示意图.png?​300 |}}+// 
 +{{ ::​状态示意图.png?​500 |}
 +// 
 +}
 ====Verilog代码==== ====Verilog代码====
 ------ ------
行 171: 行 174:
  parameter time_s1 = 4'd15,  parameter time_s1 = 4'd15,
  time_s2 = 4'd3,  time_s2 = 4'd3,
- time_s3 = 4'd10,+ time_s3 = 4'd7,
  time_s4 = 4'd3;  time_s4 = 4'd3;
   
行 278: 行 281:
 \\ \\
 ^  信号 ​         ^  引脚 ​           ^  信号 ​        ​^ ​ 引脚 ​   ^    ^  信号 ​         ^  引脚 ​           ^  信号 ​        ​^ ​ 引脚 ​   ^   
-|  **clk** ​     |  ​C1              ​| ​ **rst** ​     |  ​L14     ^ +|  **clk** ​     |  ​J5              ​| ​ **rst** ​     |  ​J9     ^ 
-|  **out[0]** ​  ​|  ​P2              ​| ​ **out[1]** ​  ​|  ​N2      ^ +|  **out[0]** ​  ​|  ​E14              ​| ​ **out[1]** ​  ​|  ​E15      ^ 
-|  **out[2]** ​  ​|  ​M2              ​| ​ **out[3]** ​  ​|  ​P4      ^ +|  **out[2]** ​  ​|  ​G15              ​| ​ **out[3]** ​  ​|  ​D12      ^ 
-|  **out[4]** ​  ​|  ​N3              ​| ​ **out[5]** ​  ​|  ​M3      ^ +|  **out[4]** ​  ​|  ​C14              ​| ​ **out[5]** ​  ​|  ​C15      ^
-\\+
 \\ \\